Course Objectives
１．HDLによる回路設計の流れを理解する。
２．Verilog HDLの文法の基礎を学習する。
３．開発ソフトの操作方法とFPGAへの実装方法を習得する。
４．基本的な組み合わせ回路と順序回路のHDL設計を演習する。
４．やや複雑な順序回路のHDL設計を演習する。
５．シミュレータを使った設計検証の基礎を習得する。
６．回路の性能評価と回路の改良について学習する。
７．ステートマシンなど，より複雑な応用回路のHDL設計を演習する。
Rubric
| 理想的な到達レベルの目安 | 標準的な到達レベルの目安 | 未到達レベルの目安 |
| 評価項目1 | 基本的な組み合わせ回路と順序回路のHDL設計を適切に演習できる | 基本的な組み合わせ回路と順序回路のHDL設計を演習できる | 基本的な組み合わせ回路と順序回路のHDL設計を演習できない |
| 評価項目2 | ステートマシンなど，より複雑な応用回路のHDL設計を適切に演習できる | ステートマシンなど，より複雑な応用回路のHDL設計を演習できる | ステートマシンなど，より複雑な応用回路のHDL設計を演習できない |
| 評価項目3 | | | |
Assigned Department Objectives
Teaching Method
Outline:
現在，大規模デジタル回路設計の主流である，ハードウェア記述言語(HDL)によるデジタル回路の設計手法を学ぶ科目である。
Style:
講義を基本とし，開発ソフトを用いて回路設計，シミュレーション，FPGAボードで実機演習を行う。試験は定期試験を行う。
Notice:
情報機器だけでなく家電製品でも広く使われている大規模デジタルＩＣを設計する方法として，現在はHDLによる方法が主流となっている。将来，ハードウェア開発に関係した仕事するためには，HDLによるＩＣ設計の基礎を学ぶことは重要である。HDLはプログラミング言語ではあるが，ハードウェアを設計していることと，回路イメージとの対応を忘れることなく，学習して欲しい。
Course Plan
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Theme |
Goals |
| 1st Semester |
| 1st Quarter |
| 1st |
ＩＣ設計の現状とHDLによる回路設計の流れ |
ＩＣ設計の現状とHDLによる回路設計の流れを理解する。
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| 2nd |
Verilog HDLの基礎 |
Verilog HDLの基礎を学ぶ。
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| 3rd |
Verilog HDLの基礎 |
Verilog HDLの基礎を学ぶ。
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| 4th |
Verilog HDLの基礎 |
Verilog HDLの基礎を学ぶ。
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| 5th |
Verilog HDLによるデジタル回路設計 |
Verilog HDLによるデジタル回路設計を行う。
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| 6th |
Verilog HDLによるデジタル回路設計 |
Verilog HDLによるデジタル回路設計を行う。
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| 7th |
中間試験 |
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| 8th |
答案返却・解答説明 |
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| 2nd Quarter |
| 9th |
Verilog HDLによるデジタル回路設計 |
FPGAボードを使って，実機上での設計演習を行う
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| 10th |
Verilog HDLによるデジタル回路設計 |
FPGAボードを使って，実機上での設計演習を行う
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| 11th |
Verilog HDLによるデジタル回路設計 |
FPGAボードを使って，実機上での設計演習を行う
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| 12th |
Verilog HDLによるデジタル回路設計 |
FPGAボードを使って，実機上での設計演習を行う
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| 13th |
Verilog HDLによるデジタル回路設計 |
FPGAボードを使って，実機上での設計演習を行う
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| 14th |
Verilog HDLによるデジタル回路設計 |
FPGAボードを使って，実機上での設計演習を行う
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| 15th |
答案返却・解答説明 |
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| 16th |
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Evaluation Method and Weight (%)
| 試験 | 発表 | 相互評価 | 態度 | ポートフォリオ | その他 | Total |
| Subtotal | 70 | 0 | 0 | 0 | 30 | 0 | 100 |
| 基礎的能力 | 0 | 0 | 0 | 0 | 0 | 0 | 0 |
| 専門的能力 | 70 | 0 | 0 | 0 | 30 | 0 | 100 |
| 分野横断的能力 | 0 | 0 | 0 | 0 | 0 | 0 | 0 |