コンピュータの構成方式と設計技術について学び、さらに、高性能なコンピュータシステムについて理解する。モデルCPUの設計手法が理解でき、実行制御部と演算処理部を設計できることを目標とする。
概要:
コンピュータシステムのハードウェア構造と動作を理解する。
本科で学んだコンピュータアーキテクチャをベースに、コンピュータハードウェアの構成方式と設計技術について現実に即して解説し、ハードウェア記述言語(VHDL)による設計手法を修得する。また、コンピュータの高性能化のための構成技術と動作原理についても学習する。
授業の進め方・方法:
授業では、座学に適宜演習を交えながら、コンピュータを構成する各部の設計手法を習得する。授業内容を理解するためには予習復習が必須である。
注意点:
本科:コンピュータアーキテクチャ(4年)
専攻科:論理設計(1年)
最終評価(最大100点)=期末試験の成績+課題加点(最大10点)
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週 |
授業内容 |
週ごとの到達目標 |
前期 |
1stQ |
1週 |
ガイダンス 組み合わせ回路についての復習 |
2進数による数値の表現、算術演算、シフト演算をハードウェア記述言語(VHDL)で実現する。
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2週 |
順序回路についての復習 |
カウンタなどをハードウェア記述言語(VHDL)で実現する。
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3週 |
制御回路についての復習 |
制御回路をハードウェア記述言語(VHDL)で実現する。
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4週 |
演算ユニットの構成法 |
演算ユニットの構成について理解する。また、VHDL記述で設計し、動作を検証する。
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5週 |
入出力装置(1) |
入出力装置の動作について理解する。
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6週 |
入出力装置(2) |
入出力装置の動作について理解する。
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7週 |
CPUの構成と命令セットの仕様 |
CPUの構成を理解すると共に、命令の種類、命令語の構成とその動作を理解する。
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8週 |
命令語とアドレス指定形式 |
命令語とアドレス指定形式ついて具体例を挙げながら解説する。
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2ndQ |
9週 |
データパスと実行制御部の構成 |
モデルCPUの命令実行に基づいてデータパスと実行制御部の構成を学ぶ。
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10週 |
実行制御部の設計 |
実行制御の状態遷移図からワイアードロジック制御とマイクロプログラム制御による実行制御について理解する。
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11週 |
実行制御部の記述設計 |
ワイアードロジック制御による実行制御部についてVHDL記述で設計する手法を学ぶ。
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12週 |
パイプライン実行制御 |
CPUを高速化する手法であるパイプライン制御の構成方法を解説し、パイプライン制御による性能の向上について解析する。
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13週 |
パイプラインハザードの回避 |
構造ハザード、制御ハザード、データハザードについて、問題と対策を解説する。
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14週 |
メモリ |
キャッシュと仮想記憶について理解する。
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15週 |
期末試験 |
コンピュータハードウェアの構造と設計技術について理解できているかを確認する出題である。
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16週 |
まとめ |
試験の解答と解説を行う。
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分類 | 分野 | 学習内容 | 学習内容の到達目標 | 到達レベル | 授業週 |
専門的能力 | 分野別の専門工学 | 情報系分野 | 計算機工学 | 論理ゲートを用いて論理式を組合せ論理回路として表現することができる。 | 5 | 前1 |
与えられた組合せ論理回路の機能を説明することができる。 | 5 | 前1 |
組合せ論理回路を設計することができる。 | 5 | 前1 |
フリップフロップなどの順序回路の基本素子について、その動作と特性を説明することができる。 | 5 | 前2 |
レジスタやカウンタなどの基本的な順序回路の動作について説明できる。 | 5 | 前2 |
与えられた順序回路の機能を説明することができる。 | 5 | 前2 |
順序回路を設計することができる。 | 5 | 前2 |
コンピュータを構成する基本的な要素の役割とこれらの間でのデータの流れを説明できる。 | 5 | 前7 |
プロセッサを実現するために考案された主要な技術を説明できる。 | 5 | 前7 |
メモリシステムを実現するために考案された主要な技術を説明できる。 | 5 | 前14 |
入出力を実現するために考案された主要な技術を説明できる。 | 5 | 前5,前6 |
コンピュータアーキテクチャにおけるトレードオフについて説明できる。 | 5 | 前7,前14 |
ハードウェア記述言語など標準的な手法を用いてハードウェアの設計、検証を行うことができる。 | 5 | 前1,前2,前3,前4,前5,前6,前9,前11 |
要求仕様に従って、標準的なプログラマブルデバイスやマイコンを用いたシステムを構成することができる。 | 5 | 前1,前2,前3,前4,前5,前6,前9,前11 |